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Quartus II 怎么使用使用UFM内部晶振

在进行时序逻辑电路设计的时候,需要使用时钟,通常我们会使用外部晶振作为时钟输入,但是在精度要求不高的情况下可以考虑使用CPLD的内部晶振,它有个名字叫做UFM。使用时需要对CPLD进行配置,这个配置自己写会比较麻烦,所以Quartus II提供了UFM库的生成向导,支持VHDL、Verilog HDL、AHDL等多种语言。这里以VHDL语言为例,分享下UFM的操作方法,希望对需要的朋友有帮助。
工具/原料

Quartus II 9.0

方法/步骤
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第1步:使用Quartus II新建一个VHDL工程,点击菜单栏的Tools ->MegaWizard Plug-In Manager...。

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第2步:在弹出的“MegaWizard Plug-In Manager [page 1]”的对话框勾选“Create a new custom megafunction variation”,接着点击“Next”。

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第3步:接下来,在“MegaWizard Plug-In Manager [page 2a]”对话框的左侧展开“Installed Plug-Ins”找到I/O。

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第4步:左侧选择“MAX II oscillator”,然后再右侧选择语言未VHDL,选择目标存储目录,最后选择“Next”。

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第5步:选择晶振频率,这里使用默认的5.56MHz,注意左侧显示了我们要使用的ufm模块的电路输入输出端口,确认后点击“Next”。

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第6步:继续点击“Next”。

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第7步:这里我们勾选ufm_inst.vhd,这个文件是UFM的模板,后面我们可以参考这个模块对UFM进行调用,另外ufm.vhd、ufm.cmp是默认处于选择状态的不要更改。

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第8步:软件有可能弹出下面的对话框,提示你是否要添加IP File到当前工程,选择“Yes”即可,如果你不想每次使用UFM都弹出它,可以勾选“Automatically add Quartus II IP Files to all projects”。

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第9步:UFM库添加完成,接下来打开ufm_inst.vhd看看ufm的具体使用方法,需要注意的是,这个文件的语法不完全,不能直接参与编译,所以不能添加到工程当中。

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第10步:新建ufm_osc.vhd,输入下面的代码,编译仿真可以看到下面的波形。这个代码的功能是将ufm模块的晶振波形使用一个名为outPort的端口输出。

注意事项

注意对于精度要求高的场合最好还是使用外部晶振。

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