soc是片上系统的简称，就是将很多功能模块进行系统的集成，大家基本上共用总线，然后挂载到总线上，soc是ic设计的趋势，可以利用现有的ip加速ic设计，减小设计的时间，使产品尽快的上市。本节介绍soc集成时要注意的问题。本节的图片均来自本人的亲自截取。
方法/步骤
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关于时钟（clk）和复位(rst_n)，为了低功耗应当对时钟进行门控，复位信号应当采用异步复位同步释放的方式。
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模块设计为总线类型接口，如果没有跨时钟域的问题则直接进行连接，如果有跨时钟域的问题需要针对性解决。
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系统集成时杜绝胶连逻辑（glue logic）
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probe_pins用于调试时抓取内部的信号，譬如某个模块中比较关键的信号可以通过它进行芯片的调试
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注意兼容性（如中断号的编排，register的安排，地址的mapping）；注意re_use，最好做到只需要open或者close define
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CSR（control state register）应该合理安排寄存器的位置，bit位等；SRAM要留有bist相关的信号
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